解密知识 解析 异步收发芯片

scc2691具有以下特性：

收发器的波特率可分别按以下方式定义：

可编程的数据格式为5~8位数据位；可选择的奇偶校验位；可编程的停止位。

从50~112k共18种固定的波特率；由计数器/定时器驱动的非标准自定义的波特率；外部时钟的1倍或16倍频。

可编程的通道方式。

2引脚定义

scc2691采用so、plcdip等形式封装。主要引脚功能定义如下。

d0~d数据总线。在cpu和uart之间所有的数据、命令、状态信息等都是通过数据总线进行传递的。在cen信号是有效低电平时，发送的方向由wrn和rdn两个读写控制决定；当cen为高电平时，数据总线三态。

wrrdn和a0~a2等引脚控制；高电平时，使uart与cpu隔离。

wrn：写选通，低电平有效。当cen为低电平时，wrn上的低电平使数据总线d0~d7上的数据被送往由地址a0~a2选中的寄存器中。

rdn：读选通，低电平有效。当cen为低电平时，rdn上的低电平将被地址a0~a2选中的寄存器的内容送往数据总线d0~d7。

a0～a地址输入端。选择执行读写操作的uart寄存器。

reset：复位输入端，高电平有效。复位时将清除uart中的状态寄存器（sr）、中断屏蔽寄存器（imr）、中断状态寄存器（isr），设置方式指针指向方式寄存器1（mr，使发送和接收失效，并且引脚txd置为高电平。intrn：中断请求输出端，低电平有效。可从七个中断源中选择一个作为uart的中断输出。cpu可以读中断状态寄存器（isr），以判断七个中断源的状态。该引脚是漏极开路输出，需要接上拉电阻。

x1/clk：晶体连接或外部时钟输入端。通常采用6864mhz的晶体。

x晶体连接端。若未连接晶体，最好使该引脚悬空。

rxd：串行数据输入端。txd：串行数据输出端。当发送器空闲、不使能或者uart工作在本地循环状态下，该引脚输出高电平。

mpo：多功能输出端。

mpi：多功能输入引脚。

3接收和发送

发送器接收来自cpu的并行数据，将其转换为串行数据流送往txd端口，串行数据流被以一个开始位、可编程个数的数据位、可选择的奇偶校验位和可编程个数的停止位的组合形式发送出去。发送结束后，若没有新的数据被送往发送保持寄存器（thr），则txd端脚保持高电平，并且状态寄存器（sr）中的位txemt置1。当cpu将一个新的数据送往thr后，txemt位清零，发送操作继续。发布一个开始break命令，可以使发送器发送一个break信号（持续的低电平）。发送器接收到一个终止发送的命令时，若其正在发送数据或thr中仍有数据，发送器会继续发送直到thr为空截止。

接收器从rxd引脚接收串行数据，检测其开始位、奇偶校验位、终止位，若有错误则设置状态寄存器（sr）中的相应位。接收器将数据送往接收保持寄存器（rhr），等待cpu以查询方式或以中断方式读取数据，并且将sr中的rxrdy和中断状态寄存器（isr）的rxrdy位置1。

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